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IX2R11
Figure 24
Enable Threshold vs. V DD Logic Supply Voltage
Figure 25
18
16
Active Low Enable
130
120
ENABLE Shut Off Delay vs. V DD Supply Voltage
Low Side
14
12
Postive Going
Outputs Disabled
110
V CL = 10V
10
8
100
90
High Side
V CL = 18V
V CL = 25V
V CL = 35V
6
4
2
Negative Going
Outputs Enabled
80
70
V CH = 10V
V CH = 18V
V CH = 25,35V
0
60
5
10
15
20
25
0
5
10
15
20
25
Figure 26
140
V DD Supply Voltage (V)
ENABLE Shutdown Delay vs. Temperature
V DD , V CL , V CH = 15V
Figure 27
1
V DD Supply Voltage (V)
Quiescent Supply Currents vs. Supply Voltages
V INL , V INH = 0V
0.9
120
100
80
High side
0.8
0.7
0.6
I CH (mA)
0.5
60
Low side
0.4
40
20
0
0.3
0.2
0.1
0
I DD (uA)
I CL (mA)
-60
-40
-20
0
20 40 60
Temperature (C)
80
100
120
140
0
5
10 15 20 25 30
V CL , V CH , V DD Supply Voltage (V)
35
40
Figure 28
Quiescent Supply Current vs. Temperature
V DD ,V CL ,V CH = 15V V INL , V INH = 0V
0.9
0.8
0.7
Figure 29
LIN, HIN Input Bias Current vs. V DD Supply Voltage
20
18
16
0.6
V CH (mA)
14
12
0.5
10
0.4
8
0.3
6
0.2
0.1
0
V CL (mA)
V DD (uA)
4
2
0
-100
-50
0
50
100
150
0
5
10
15
20
25
Temperature (C)
IXYS reserves the right to change limits, test conditions, and dimensions. 10
V DD Voltage (V)
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